究竟威力有多大:DDR3內存性能全面評測[圖]-IT浪潮-北方網
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究竟威力有多大:DDR3內存性能全面評測[圖]


http://www.enorth.com.cn  2007-06-06 13:52

二、DDR3與DDR2有什麼不同之處?

  我們先來看一看技術規格對比表,從表中可以看到DDR3內存相對於DDR2內存,其實只是規格上的提高,並沒有真正的全面換代的新架構。

DDR1
DDR2
DDR3
電壓 VDD/VDDQ
2.5V/2.5V
1.8V/1.8V
(+/-0.1)
1.5V/1.5V
(+/-0.075)
I/O接口
SSTL_25
SSTL_18
SSTL_15
數據傳輸率(Mbps)
200?400
400?800
800?2000
容量標准
64M?1G
256M?4G
512M?8G
Memory Latency(ns)
15?20
10?20
10?15
CL值
1.5/2/2.5/3
3/4/5/6
5/6/7/8
預取設計(Bit)
2
4
8
邏輯Bank數量
2/4
4/8
8/16
突發長度
2/4/8
4/8
8
封裝
TSOP
FBGA
FBGA
引腳標准
184Pin DIMM
240Pin DIMM
240Pin DIMM

  1、邏輯Bank數量

  DDR2 SDRAM中有4Bank和8Bank的設計,目的就是為了應對未來大容量芯片的需求。而DDR3很可能將從2Gb容量起步,因此起始的邏輯Bank就是8個,另外還為未來的16個邏輯Bank做好了准備。

  2、封裝(Packages)

  DDR3由於新增了一些功能,所以在引腳方面會有所增加,8bit芯片采用78球FBGA封裝,16bit芯片采用96球FBGA封裝,而DDR2則有60/68/84球FBGA封裝三種規格。並且DDR3必須是綠色封裝,不能含有任何有害物質。

  3、突發長度(BL,Burst Length)

  由於DDR3的預取為8bit,所以突發傳輸周期(BL,Burst Length)也固定為8,而對於DDR2和早期的DDR架構的系統,BL=4也是常用的,DDR3為此增加了一個4-bit Burst Chop(突發突變)模式,即由一個BL=4的讀取操作加上一個BL=4的寫入操作來合成一個BL=8的數據突發傳輸,屆時可通過A12地址線來控制這一突發模式。而且需要指出的是,任何突發中斷操作都將在DDR3內存中予以禁止,且不予支持,取而代之的是更靈活的突發傳輸控制(如4bit順序突發)。

  4、尋址時序(Timing)

  就像DDR2從DDR轉變而來後延遲周期數增加一樣,DDR3的CL周期也將比DDR2有所提高。DDR2的CL范圍一般在2至5之間,而DDR3則在5至11之間,且附加延遲(AL)的設計也有所變化。DDR2時AL的范圍是0至4,而DDR3時AL有三種選項,分別是0、CL-1和CL-2。另外,DDR3還新增加了一個時序參數——寫入延遲(CWD),這一參數將根據具體的工作頻率而定。

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編輯:趙國棟
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